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平面低通滤波器简介随着现在微波链路越来越高频化，小型化，直接在链路中集成低通的现象越来越普遍。同时很多芯片化的低通也大都是在高介电陶瓷片上实现的微带滤波器。陶瓷片型的芯片电容，电感，均衡器都需要用到平面低通的设计概念。常见的低通滤波器在ADS中的模型及结构形式见。常见的平面结构低通滤波器三种结构的优缺点对比见表1，通常对要求比较高的设计时可综合三种结构的优缺点进行折中设计。表1三种结构优缺点对比2.平面低通滤波器设计的理论基础本次总结的理论基础来源，核心理论为的高低阻抗线等效电路。测试的是信号边沿时间，边沿时间是指隐性电平到显性电平时间和显性电平到隐性电平变化的总时间。隐性电平(逻辑值0)到显性电平(逻辑值1)时间为上升沿，显性电平到隐性电平为下降沿。边沿时间分为上升沿时间、下降沿时间。下降沿时间是按照电压(20﹪~80﹪电压区间，有些按照10﹪~90﹪电压区间测量边沿时间，文中以20﹪~80﹪电压区间测量边沿时间)。表中给出时间范围，如果超出规定时间，会造成波形位宽增加，采样点取值不准确，波特率异常，出现大量错误帧，一直重发数据帧也会造成CAN总线通信瘫痪。
